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以上只是 一 些进行DDR读/写信号分离的常用方法，根据不同的信号情况可以做选 择。对于DDR信号的 一 致性测试来说，用户还可以选择另外的方法，比如根据建立/保持 时间的不同进行分离或者基于CA信号突发时延的方法(CA高接下来对应读操作，CA低 接下来对应写操作)等，甚至未来有可能采用一些机器学习(Machine Learning)的方法对 读/写信号进行判别。读时序和写时序波形分离出来以后，就可以方便地进行波形参数或者 眼图模板的测量。
克劳德高速数字信号测试实验室 DDR测试信号问题排查；辽宁DDR一致性测试眼图测试
DDR地址、命令总线的一致性测试
DDR的地址、命令总线的信号完整性测试主要测试其波形和时序参数。地址总线An、 命令总线/RAS、/CAS、/WE、/CS需要测试的信号品质主要包括：Vmax （最大电压值）；Vmin （小电压值）；Overshoot （过冲）和Undershoot （下冲）的持续时间的大值；Slew Rate （斜率）；Ringback （回沟）等。还需要测试相对于时钟边沿的Setup Time （建立时间）和Hold Time （保持时间）。建立时间和保持时间的定义如图7.134所示，其中加为建立时间，如为 保持时间，针对DDR400,加和如为0.7ns。
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DDR的信号仿真验证
由于DDR芯片都是采用BGA封装，密度很高，且分叉、反射非常严重，因此前期的仿 真是非常必要的。借助仿真软件中专门针对DDR的仿真模型库仿真出的通道损 耗以及信号波形。
仿真出信号波形以后，许多用户需要快速验证仿真出来的波形是否符合DDR相关规 范要求。这时，可以把软件仿真出的DDR的时域波形导入到示波器中的DDR测试软件中 ,并生成相应的一致性测试报告，这样可以保证仿真和测试分析方法的一致，并且 便于在仿真阶段就发现可能的信号违规
由于DDR4的数据速率会达到3.2GT/s以上，DDR5的数据速率更高，所以对逻辑分析仪的要求也要很高，需要状态采样时钟支持1.6GHz以上且在双采样模式下支持3.2Gbps 以上的数据速率。基于高速逻辑分析仪的DDR4/5协议测试系统。图中是通过 DIMM条的适配器夹具把上百路信号引到逻辑分析仪，相应的适配器要经过严格测试，确 保在其标称的速率下不会因为信号质量问题对协议测试结果造成影响。目前的逻辑分析仪可以支持4Gbps以上信号的采集和分析。扩展 DDR4 和 LPDDR4 合规性测试软件的功能。
DDR5的接收端容限测试
前面我们在介绍USB3 . 0、PCIe等高速串行总线的测试时提到过很多高速的串行总线 由于接收端放置有均衡器，因此需要进行接收容限的测试以验证接收均衡器和CDR在恶劣 信 号 下 的 表 现 。 对 于 D D R 来 说 ， D D R 4 及 之 前 的 总 线 接 收 端 还 相 对 比 较 简 单 ， 只 是 做 一 些 匹配、时延、阈值的调整。但到了DDR5时代(图5 . 19),由于信号速率更高，因此接收端也 开 始 采 用 很 多 高 速 串 行 总 线 中 使 用 的 可 变 增 益 调 整 以 及 均 衡 器 技 术 ， 这 也 使 得 D D R 5 测 试 中必须关注接收均衡器的影响，这是之前的DDR测试中不曾涉及的。 DDR4 总线物理层仿真测试和协议层的测试方案；安徽测量DDR一致性测试
DDR3 和 LPDDR3 一致性测试应用软件。辽宁DDR一致性测试眼图测试
软件运行后，示波器会自动设置时基、垂直增益、触发等参数并进行测量，测量结果会 汇总成一个html格式的测试报告，报告中列出了测试的项目、是否通过、spec的要求、实测 值、margin等。
使用自动测试软件的优点如下所述：
•自动化的设置向导避免连接和设置错误；
•快速的测量和优化的算法减少测试时间；
•可以测试JEDEC规定的速率也可以测试用户自定义的数据速率;
•独有的自动读写分离技术简化了测试操作；
•能够多次测量并给出一个统计的结果；
•能够根据信号斜率自动计算建立/保持时间的修正值。 辽宁DDR一致性测试眼图测试
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